科技微光|金盆岭实验室第五弹：数电来袭，组合电路的设计！

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走进实验室一直是电气学子心中最重要的一步

将所学与应用实践相结合

参加各种科技竞赛培养自己的动手能力

电气学子一直乐此不疲

时光飞逝，

本学期最后一节

金盆岭校区电子培训课终于如约而至，

大家484迫不及待的想了解这次的内容了呢？

now，让我们一起走进这次的课堂吧~

▷组合电路的设计步骤在实例中的运用

今天授课的依然是我们帅气博学的张一斌老师

上节课张老师主要为我们讲述了数字电路（二值电路），逻辑关系与逻辑电路，组合逻辑电路的设计的概念与特征。

现在，让我们一起学习这次的课程吧~

  1、用组合电路的设计步骤设计加法器；

  2、用组合电路的设计步骤设计减法器；

  3、用组合电路的设计步骤设计显示译码器；

  4、用组合电路的设计步骤设计三人表决器。

因为方法一致，在这里就重点以加法器为例进行讲解哦

（1）半加器的设计

上图即为半加器的设计步骤。其中真值表中A为被加数，B为加数，A、B是输入值；S为A、B的和，C为进位值（当A,B皆为1时，相加为2，向前进一位，即在C处值为“1”，S处值为“0”）真值表右边输入的数值为“0”时被加数表示为，加数为，为“1”时则以A,B表示由此可得与“m”的关系式。逻辑表达式S、C则以真值表中S、C不为“0”时所对应的“m”值所示（如下图）。

电路图的设计是在逻辑表达式的基础上绘制的，由两个非门电路，三个与门电路，以及一个或门电路组成。右端所示为半加器“HA”的简化电路图。

（2）全加器的设计

全加器的设计与半加器相似，虽输入值多了一个，但计算原理基本一致

逻辑式的化简主要是将式子中一致的字母提出，并记住一个字母的非值与原字母相加得“1”，以此将表达式S、C化简。（如上图）

如此图所示，以逻辑表达式列表，从而得出电路图。

8位加法器（一个半加器与七个全加器组成）

三位加法器

设计步骤与加法器一致，在真值表计算时输入值A、B分别为减数与被减数，输出值d为差值，c为借位值（即A＜B时向高位借一得到）。其余步骤与原理与加法器基本一致。

显示译码器运算稍显复杂，但原理是一致滴，小伙伴们别慌！

上图中的表是从上面真值表的运算中演变过来的，

以此来绘制电路图。

所谓“三人表决”自然是有三个输入、一个输出，计算原理及步骤与上一至，就不多说啦。同学们可以自己绘制三人表决器的电路图哟。

今天上课，小阔耐们一如既常的认真哟！

 那么本次培训课到这里就圆满结束啦！

同学们在假期空闲时可别忘了

再次回顾本学期的培训知识哟。

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审核 | 蔡戈琳 史一茹

编辑 | 李茂林

来源 | 图：科技部伍耀瑞，李子薇

         文：科技部李子薇

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